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WorksheetsATIVIDADE AVALIATIVA DE REVISÃO DE SD - 3ª MENÇÃO
Total questions: 50
Worksheet time: 59mins
Qual é a tabela verdade da seguinte porta?
O circuito integrado 7486 mostrado na figura pertence a que porta lógica?
OR
AND
NOT
XOR
Qual função lógica corresponde à seguinte tabela verdade?
OR exclusiva
NOR
NAND
NOR exclusiva
Ramo da eletrônica com base em tensões discretas que têm um valor definido:
Digital
Analógico
Composto
Programável
A porta lógica mostrada na imagem corresponde a um:
NAND
NOR
AND
OR
O circuito mostrado na imagem cumpre a função booleana:
F=A ∗ B+B ∗ C
F=A∗B+B∗C
F=A∗B+B∗C
F=A∗B+B∗C
O circuito lógico correspondente à função booleana (a+b) ∗ c é:
A função booleana correspondente ao mapa de Karnaugh mostrado é:
a ⋅ b+b ⋅ c
a ⋅ b+b ⋅ c
a ⋅ b+b ⋅ c
a ⋅ b+b ⋅ c
Selecione os nomes dos seguintes operadores lógicos em ordem:
OR-NAND-AND-NOR
AND-NAND-OR-NOR
AND-NOR-OR-NAND
Qual das seguintes sentenças é a resposta simplificada de:
AB
ABC
ABC
ABC
Qual é a saída do seguinte circuito lógico?
(BA)*(CA)
AB+CA
(AB)*CA
AB+AC
O seguinte é uma porta AND, seu equivalente é
A seguir está uma porta AND, seu equivalente é.
A porta a seguir é XOR, a fórmula é.
𝑄 = 𝐴 ∗ 𝐵̅ + 𝐴̅ ∗ 𝐵
Q = (A)(B) + (A) (B)
𝑄 = 𝐴 ∗ 𝐵 + 𝐴
A próxima porta é XNOR, a fórmula é.
𝑄 = 𝐴 ∗ 𝐵̅ + 𝐴̅ ∗ 𝐵
Q = (A)(B) + (A)(B)
𝑄 = 𝐴∗𝐵+𝐴 ̅∗𝐵 ̅
Circuitos lógicos combinacionais são aqueles cujos níveis lógicos de saída dependem:
dos níveis lógicos de entrada e de seu armazenamento interno.
dos níveis lógicos de entrada e de seu armazenamento externo.
somente dos níveis lógicos de entrada.
somente de seu armazenamento interno.
somente de seu armazenamento externo.
A simplificação da expressão Z = (Ā + D)(A + D) é igual a
Ā + D.
A.
D + A.
D.
1
Analise a figura a seguir.
Acima é apresentado um circuito lógico, cuja resposta na saída é dada pela por
Sobre portas lógicas e suas utilizações em circuitos digitais,
assinale a alternativa correta.
Em uma porta lógica tipo NOR (“NÃO-OU”), a saída terá nível
lógico “1” sempre que todas suas entradas estiverem em nível
lógico “1”.
Em uma porta lógica tipo NOR (“NÃO-OU”), a saída terá nível
lógico “1” sempre que todas suas entradas estiverem em nível
lógico “1”.
Em uma porta lógica tipo XOR (“OU Exclusivo”), a saída terá nível
lógico “1” sempre que todas suas entradas estiverem em nível
lógico “0”.
Em uma porta lógica tipo AND (“E”), a saída terá nível lógico “1”
sempre que todas suas entradas estiverem em nível lógico “0”.
Em uma porta lógica tipo OR (“OU”), a saída terá nível lógico
“1” sempre que ao menos uma de suas entradas estiver em
nível lógico “1”.
Com relação aos conceitos abaixo:
I - Somas dos Produtos:
Separa as linhas que possui como saída o bit 1. Usa-se uma porta AND para combinar as entradas das seguintes forma: A entrada que apresenta o bit 1 fica normal e a entrada que apresenta o bit 0 fica negada.
II - Produto das Somas
Separa as linhas que possui como saída o bit 0. Usa-se uma porta OR para combinar as entradas das seguintes forma: A entrada que apresenta o bit 0 fica normal e a entrada que apresenta o bit 1 fica negada.
I e II estão corretas
I e II estão incorretas.
Somente I correta.
Somente II correta.
Mapa de Karnaugh permite a simplificação mais rápida dos casos extraídos de tabela verdade, obtidas de situações quaisquer de forma mais otimizada.
True
False
Na igualdade X + YZ = YZ + X a lei ou propriedade foi aplicada:
Associativa
Distributiva
Comutativa
Todas estão corretas
Das seguintes igualdades, a verdadeira é:
A B=(A +B)
AB=(A+B)
A=AB +A B
AB =(A +B) (A +B)
Selecione os símbolos que correspondem às portas que têm as seguintes funções de saída:
AB + A´B´
A´B + A B´
O uso de álgebra booleana simplifica a seguinte função:
F = ( Y + Z´ ) ( Y´ + Z ) + X+ Y + X´ + Z Z´
0
X+ Y
1
Y + X´
Selecione a tabela de operação para o seguinte circuito. Use as variáveis A, B e C para cada uma das entradas.
Selecione a imagem que corresponde à porta para fazer um circuito que realiza a soma lógica negada de duas variáveis.
Qual dos seguintes circuitos digitais é do tipo sequencial?
Multiplexador
Codificador
Comparador
Nenhuma das Alternativas
Qual dos seguintes circuitos digitais é do tipo combinacional?
Biestável
Multiplexador
Contador
Latch
Em SR Flip-Flops, dadas as entradas S = 0, R = 0 e estado atual Qn = 0. Encontre o próximo estado Qn + 1.
01
1
Dont care
0
Dada a tabela de excitação SR com o estado presente Qn = 0, próximo estado Qn + 1 = 1, então encontre as entradas
S=0 , R = 1
S=1 , R= 0
S=0 , R = x
S=x , R= 0
v
a borda ascendente do clock
a queda do clock
nível de clock alto.
nível de clock baixo.
Considere o circuito mostrado abaixo. Qual das seguintes afirmações é verdadeira?
O circuito manteria o estado anterior para S = 0, R = 0.
O circuito manteria o estado anterior para S = 0, R = 1..
O circuito manteria o estado anterior para S = 1, R = 1.
O circuito nunca seria capaz de manter o estado anterior sob qualquer condição
Um SR-latch é criado usando apenas duas portas NOR com entradas S e R alimentando uma porta NOR cada. Se ambas as entradas S e R forem definidas como um, as saídas serão
Q e Q ' ambos 1
Sem mudança na saída do circuito
Q e Q ' ambos 0
Q e Q ' complementares entre si
CLEAR apoia ..
definir um bit mais baixo
definir um bit alto
trocar o valor de um bit
RESET apoia .
ligar uma saída Q
desligar uma saída Q
trocar o valor de um bit
SET apoia ..
ligar uma saída Q
desligar uma saída Q
trocar o valor de um bit
Qual circuito é esse?
FF JK
FF SR
LATCH SR
LATCH com ENABLE
Qual circuito é esse?
FF JK com PRESET e CLEAR
FF JK
FF JK com CLEAR
FF com ENABLE
DACs integrados qualificados como conversores multiplicadores são caracterizados pelo fato de que:
Eles emitem um sinal proporcional ao produto dos dados digitais pelo valor de Vref, que deve ser estável
Eles emitem um sinal proporcional ao produto dos dados digitais pelo valor de Vref, que pode variar
Multiplique o sinal de saída por um fator dependente de um amplificador externo
Multiplique os dados de entrada digital por um fator dependente de um sinal de controle digital
Considerando o tempo de conversão dos ADCs, as técnicas que oferecem o melhor desempenho são, na ordem:
Por aproximações sucessivas, por rampa digital, por integração
Rampa digital, aproximações sucessivas, integração
Para comparadores, para aproximações sucessivas, para integração
Para comparadores, para integração, para aproximações sucessivas
O tempo de conversão para um ADC de aproximação sucessiva de n bits depende de:
Da frequência do clock
A partir do valor do sinal analógico a ser convertido
Da frequência do clock e do valor do sinal analógico a ser convertido
Desde a duração do impulso para iniciar a conversão
Um DAC R-2R com quatro bits de entrada usa para a realização da rede de resistores:
Dois resistores de valores diferentes
Quatro resistores de valores diferentes
Dois resistores
Oito resistores de valores diferentes
Para gerar uma tensão com um DAC atual, é necessário conectar à saída DAC:
Um resistor, independentemente da amplitude da tensão de saída e da capacidade da carga
Um conversor de frequência para tensão
Um conversor de corrente para tensão com Amps op para grandes oscilações do sinal de saída e capacidade de carga
Nenhuma das alternativas
Um DAC de 8 bits com um valor de escala total de 10 V tem uma resolução de:
1.25%
125%
3.9%
0.039%
Uma vantagem do R-2R Ladder tipo DAC é a necessidade de apenas 2 valores de resistor
Verdadeiro
Falso
Qual é a principal desvantagem do conversor analógico para digital (ADC) do Flash?
Requer que a tensão de entrada seja aplicada às entradas simultaneamente
um longo tempo de conversão é necessário
um grande número de linhas de saída é necessário para decodificar simultaneamente a tensão de entrada
um grande número de compactadores é necessário para representar um número binário de tamanho razoável
Em um conversor analógico para digital flash, a saída de cada comparador é conectada a uma entrada de ______________
decodificador
codificador de prioridade
multiplexador
demultiplexador
Qual é o maior no DAC?
Tensão de escala completa
Voltagem de referência
Escala completa e tensão de referência
